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利用系統(tǒng)生成器（System Generator）實(shí)現(xiàn)的DSP設(shè)計(jì)培訓(xùn)

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        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
        2、課程完成后,授課老師留給學(xué)員手機(jī)和Email,保障培訓(xùn)效果,免費(fèi)提供半年的技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。

課程對(duì)象

對(duì) DSP 設(shè)計(jì)培訓(xùn)感興趣、正在利用 MathWorks MATLAB? 和 Simulink? 軟件實(shí)現(xiàn) DSP 算法以及希望使用 Xilinx System Generator for DSP 設(shè)計(jì)的系統(tǒng)工程師、系統(tǒng)設(shè)計(jì)者、邏輯設(shè)計(jì)者與有經(jīng)驗(yàn)的硬件工程師

課程概要

1

• 系統(tǒng)生成器簡(jiǎn)介
• Simulink 軟件基礎(chǔ)
• 實(shí)驗(yàn)1：利用 Simulink 軟件
• Basic Xilinx Design Capture
• 實(shí)驗(yàn)2：利用 Xilinx 系統(tǒng)生成器著手設(shè)計(jì)
• Signal Routing
• 實(shí)驗(yàn)3：信號(hào)路由
• 實(shí)現(xiàn)系統(tǒng)控制
• 實(shí)驗(yàn)4：實(shí)現(xiàn)系統(tǒng)控制

2

• 多速率系統(tǒng)
• 實(shí)驗(yàn)5：設(shè)計(jì)基于 MAC 的 FIR
• Filter Design
• 實(shí)驗(yàn)6：利用 FIR 編譯器模塊設(shè)計(jì) FIR 濾波器
• System Generator、 Vivado Design Suite、項(xiàng)目導(dǎo)航器和 XPS 集成
• 實(shí)驗(yàn) 7:?System Generator 和 Vivado IDE 集成
• Kintex-7 FPGA DSP 平臺(tái)
• 實(shí)驗(yàn) 8a:?System Generator 和 Vivado HLS 工具集成
• 實(shí)驗(yàn) 8b:?AXI-4 Lite 接口綜合